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授業科目名
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担当教官
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ディジタル回路特論
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清弘 智昭／石川 稜威男
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時間割番号
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単位数
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コース
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履修年次
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期別
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曜日
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時限
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| 322094 | 2 | (未登録) | 1 | 前期 | 木 | II |
| ［概要と目標］ | ||||||
| この講義では，学部でのディジタル回路の講義をふまえ，学部の講義では触れることの無かったHDLなどのハードウェア記述言語によるディジタル回路のトップダウン設計法を学ぶ．また，Eコースの学生は計算機アーキテクチャを学習していないので，基礎的な計算機アーキテクチャについても学習し，その１部をHDL等で記述してCPLDまたはFPGAで実現する実習をおこなう。 この講義の到達目標は， 1. コンピュータの構成，CPUの働きなどの基礎概念を理解すること 2. ハードウェア記述言語を用いたディジタル回路設計法を理解し，簡単な回路の設計ができること 3. PLD・FPGA・ゲートアレイなどのハードウェアの性質と用途を理解すること 4. シミュレータによる回路検証の考え方を理解し，簡単なシミュレーションを実行できること などである． |
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| ［必要知識・準備］ | ||||||
| 学部の「ディジタル回路」，「計算機アーキテクチャ」を履修していないと授業についていくのは難しい | ||||||
| ［評価基準］ | ||||||
| レポートの課題を数回，おぴょび期末にＶＨＤＬによるＣＰＵ設計の課題を課す。このレポートで60点以上を得れば合格とする。 配点は以下の通り レポートの平均 ５０ 期末課題 ５０ |
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| ［教科書］ | ||||||
| ［参考書］ | ||||||
| (未登録) | ||||||
| ［講義項目］ | ||||||
| 1. ディジタル回路設計手法 ＩＣの種類と特徴，ハードウェア記述言語， FPGAとCPLD，ボトムアップとトップダウン設計 2. コンピュータの基本構成 マイコン開発の歴史，ＣＰＵ，メモリ，ＩＯ，バス 3. ＣＰＵの構成 モデルＣＰＵの概要，レジスタのしくみ，汎用レジスタ，ＡＬＵ，プログラムカウンタ，命令レジスタ，スタックポインタ，命令デコーダ，制御部，バスバッファ 4. ＣＰＵの働き１ ＣＰＵの内部操作，マイクロオペレーション，命令フェッチ，命令実行，メモリストア，メモリロード，演算処理 5. ＣＰＵの働き２ 分岐命令，スタックとその働き，スタックポインタ，ＰＵＳＨ，ＰＯＰ命令 6. ＣＰＵの働き２ サブルーチンの概念，ＣＡＬＬ，ＲＥＴ命令，ＩＯ 7. オペレーティングシステム 割込処理，ＯＳの概念，MS-DOS，BIOS，BDOS，マルチタスク 8. 組み合わせ回路とそのHDLによる記述 マルチプレクサ，デコーダ，HDLによるシミュレーション 9. 演算回路 半加算器，全加算器，補数器，ＡＬＵの実現 10. フリップフロップとそのHDLによる記述 フリップフロップの種類，レジスタ，カウンタ， 11. 順序回路とそのHDLによる記述 順序回路の設計，HDLによる順序回路の実現 12. HDLによるCPUの記述および演習 13. HDLによるCPUの記述および演習 |
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